18兆位的DDR II + SRAM双字突发架构（ 2.5周期读延迟） 18-Mbit DDR II+ SRAM Two-Word Burst Architecture 2.5 Cycle Read Latency
SRAM - 同步，DDR II+ 存储器 IC 18Mb（512K x 36） 并联 400 MHz 165-FBGA（13x15）
立创商城:
CY7C1150KV18-400BZXC
艾睿:
SRAM Chip Sync Single 1.8V 18M-Bit 512K x 36 0.45ns 165-Pin FBGA Tray
| 图片 | 型号 | 厂商 | 下载 |
|---|---|---|---|
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