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VHDL_优先编码器程序

时间:2024-04-29 14:37:10

ENTITY prior_encoder ISPORT(i0,i1,i2,i3:IN BIT;           y0,y1:OUT BIT);END prior_encoder;ARCHITECTURE behavioral OF prior_encoder ISBEGINcale:PROCESS(i0,i1,i2,i3)     VARIABLE temp:std_logic_vector(1 downto 0);BEGIN IF i3='0' THEN temp:="11"; ELSEIF i2='0' THEN temp:="10"; ELSEIF i2='0' THEN temp:="01"; ELSEIF i3='0' THEN temp:="00";END IF;y0<=temp(0);y1<=temp(1);END PROCESS;END behavioral;

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